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余数系统下的加法器设计

作品编号:DZDQ773 开发环境: WORD全文:44页 论文字数:16000
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[TAGS:加法器 指数:]
总结
本课题重点研究的是模加法器中进位拉链的实现算法,结构及相关内容,实现了一款性能较优异的基于特殊模的 加法器。
论文分别从余数系统的背景、二进制加法器的研究概况、模加法器的结构分析、以及各种模加法器性能分析比较等层次展开讨论,研究内容主要包括以下几点:
◆ 余数系统的背景,在一个层次中,对为何引用余数系统下以及余数系统下的各种理论有一个比较深刻的分析和理解。
◆ 二进制加法器的研究概况,在这一层次中,了解了加法器的发展历程、提出了并行前缀算法以及几种并行前缀加法器结构,主要理解并行前缀算法。
◆ 模加法器的结构分析,在这一层次中,分别对普通模以及特殊模的模加法器进行了算法和结构实现。通过方法比较以后,提出一种新的基于特殊模的模加法器结构,并用算法实现。
◆ 各种模加法器的性能分析比较,在这一层次中,通过在不同方法、不同类型以及同一类型间的纵向比较,对模加法器的性能进行分析比较以后,得到所设计的新的基于特殊模数基的模加法器结构的优缺点。
在本文撰写的同时,相关的研究工作仍在不断深入,在已有研究成果的基础上,继续深入的开展课题研究是必然的发展方向,今后进一步工作的重点集中在以下几个方面:其一,性能的追求是永无止境的。即使现在模加法器研究已经很成熟了,高速、低功耗、小延迟的加法器始终是我们永远的目标;第二方面、对RNS的研究工作继续深入。由于我国集成电路起步较晚,因此对于RNS在VLSI前端设计中的应用研究并不多,如今,集成电路产业是我国高新技术的重点发展对象,因此对RNS的研究非常必要。


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