结论
在现代电子系统中，FIR数字滤波器以其良好的线性特性被广泛使用。在通信或雷达领域的高速实时信号处理中,通常包含大量的高速高阶FIR滤波器的设计。它们要求滤波器速率高、阶数大，导致最终运算量非常大。若使用DSP芯片则需多片处理完成,使得系统的工作延迟长、成本高、功耗大、调试困难。本文根据CSD(Canonic Signed Digital) 算法的思想,实现了高阶高速FIR滤波器的优化设计。为了更好的验证仿真结果的正确性，文中应用了MATLAB、ModelSim和Verilog HDL联合仿真方法对设计的电路进行仿真测试，结果达到设计指标，证明了所设计的FIR数字滤波器的正确性。
在本课题的设计与研究过程中，有所突破的地方如下:
1、使用硬件描述语言（HDL），可以用仿真方式完成以前必须设计和建造好样本才能进行的电子电路特性的说明和调试。可以使用仿真器测试所设计的电路功能是否正确，从而能够大大减少设计的成本和时间。
2、运用CSD编码来实现其架构且采用半带滤波器的方法来设计。由于CSD编码中非零比特数比二的补码的表示中要少33%，因此有效地减少了硬件实现所用面积和路径延时。在此基础上设计中还根据Horner法则来进一步提高系统的精度和面积，使设计的结果更准确。
在本课题的设计与研究过程中，主要的实际应用之处：
在实际应用当中，CSD架构的位串行FIR滤波器的运算速度较快，滤波器面积也相对较小，其应用也比较多，比较符合更多人的需求。因此学会滤波器的硬件设计是很有意义的。当然，本人所设计的还是比较基础的环节，在实际过程中，还需要有相当深厚的专业知识，以及对各个环节要相当了解。
由于本人能力有限，在设计当中还存在一些不完善的地方，如所编写的程序不够完美，很多都是简单程序的循环使用，以及所设计滤波器的结构还应该得到进一步的优化，这样将会使最终的结果更加准确、可靠。


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