总结
本课题作为实现多只机器狗间相互通信的系统的前期的一个预研工作。主要展开运用FPGA来制作接口电路，完成机器狗的对无线数据的收发，由操作者发出信息来模仿来自其他机器狗的信息。并且制作一系列控制电路帮助减轻主控器的负担，使主控器能够完成更多的事件。只有首先实现对一只机器狗能够正常的进行数据接发，才能保证以后多只机器狗间相互通信这个大系统的设计。
本次毕业设计历时几个月，在老师的指导下同组同学的共同努力下设计取得了一定成果。通过在实验室的工作和学习，把很多知识从不懂变成熟悉，在理论知识提高的同时，我的实际动手能力也提高了。
在本次毕业设计中我熟悉了无线通信系统的设计流程，掌握基本通信协议的设计；掌握nRF2401使用方法，给出针对本设计的使用报告；熟练掌握Quartus2软件，能够通过该软件进行基于Verilog HDL语言的数字系统设计和仿真；并能够在FPGA上对收发数据进行信息融合处理。基本能达到设计的预期指标。
1、设计中存在的主要问题
本次设计，在老师的悉心指导下，自己的努力，取得了一定的成绩，但由于基础不牢，加上时间紧张，系统整体功能没有调试成功。主要存在以下问题：
第一，在本次毕业设计之前，没有接触过FPGA，在专业选修课中也未学习关于EDA的知识，在基础方面完全是一片空白。在开始毕业设计以后，经过罗老师的指导和培训，才开始慢慢了解FPGA。在大四寒假，才开始对Verilog HDL语言的学习和使用，但是对于一门新学习的编程语言，要想在短短的一两个月里完全掌握它并能够用它熟练的编写程序是有困难的。而对于Quartus2软件的学习也是从罗老师给我们培训开始的，而真正意义上的独立使用则是在熟练Verilog HDL语言后对系统编程的时候才开始的。因此，时间也非常短暂。但通过自己的努力学习，勤加苦练，终于掌握了Verilog HDL语言的编程技巧和Quartus2软件的使用方法。
第二，该系统作为一个大课题下的分支课题，与同组的其他成员的协调跟合作是不可缺少的。由于在这方面做得比较欠缺，导致全组工作进度不一致，最终未能实现设计的全部功能。
2、系统的不足
由于设计缺乏经验，又是初学Verilog HDL语言，因此在功能模块的划分上显得有些复杂和烦琐。有些功能可以综合到一个模块下，但限于刚刚入门，往往是心有余而力不足，因此在实现某些功能上才用的方法还值得改进。比如在配置模块下的移位计数模块，在本设计中采用的是将15个8位移位寄存器的方法......


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